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      1. 威盛logic筆試題

        時間:2022-07-31 03:28:49 綜合指導 我要投稿
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        給出了兩個真值表,讓你用具有第一個真值表特性的模塊來構造一個
        具有第二個真值表性質的電路
        2。給出一個方波信號A,一個在方波某個posedge后一點點后assert的信號B
        讓你保證信號C(B&A)是glitch free的
        3.給出一個總線事務的控制信號關系.GRANT,STRAT,END.畫出時序圖.
        并寫出verilog code控制STRAT信號
        4.159.xxx轉換進制Bin和Hex
        5.解釋Interupt
        6.一道GRE 邏輯題.5輛car顏色不同,driver不同,MilersperGollen不同.
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